멘토 소개
CL2 / 4년 차
사소한 예외 상황도 놓치지 않는
꼼꼼한 검토가 중요합니다.
| 직무 |
디지털회로설계(검증)
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| 부서 |
회로설계
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| 전공 |
전기전자공학 (건국대)
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| 근무 |
경기도 이천
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| 🎓 최종학력 |
건국대학교 전기전자공학부 졸업 (2021)
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| 📊 학점 |
3.62 / 4.5 (전공 3.6)
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| 🌐 어학 |
TOEIC 820 점 · OPIc IH
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| 📜 자격증 |
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| 🏢 인턴 |
-
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| 🏆 수상 |
중앙 동아리 부회장
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| 💡 입사포인트 |
반도체 중소 / 중견 기업에서 경력 이직
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SOC / IP 검증 계획 및 시나리오 수립
- 스펙 기반 RTL 구조 분석 및 계획 수립
- 하드웨어 버그 사전 차단 및 안정성 확보
- 블록 레벨 Corner Case 시나리오 발굴
- Functional/Code Coverage 목표 달성
UVM 기반 검증 환경 개발
- System Verilog 및 UVM 프레임워크 활용
- Driver/Monitor 등 검증 컴포넌트 설계
- Constrained Random 자동 테스트 구현
- 시뮬레이션 기반 검증 자동화 시스템 구축
RTL 디버깅 및 검증 자동화 툴 개발
- Waveform 분석을 통한 논리 오류 디버깅
- RTL 디자이너와의 수정 및 검증 협업
- Python 스크립트 기반 로그 분석 툴 개발